)緊急(信号

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Guest

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、こんにちは

私は)時間が1クロックサイクル(256の後に必要高さにgeneretコントローのsignal.whichをすべきこと)の後サイクル(2回、それが必要高後に128。

このために提案してください。

 
私は普通のこと種のそのカウンタのために使用します。

あなたが終了シーケンスが、結局は言う始まる何が起きるかシーケンス。私は"私倍もわからない、2つの"何を意味し、"1回"と。私は256 =よトンでパルスをしたい推測すると、トン= 384、およびt = 512。

これは?あなたが入力をリセット追加することがしたい。
コード:

モジュール上は(CLKを、)制御を開始する。

入力CLKを、開始。

[8:0]カウントregの= 0;

出力レッグ制御= 0;常に@(posedge CLK)は開始

カウント<=カウント は、(|(カウントを開始!= 0));

制御<=(カウント== 256から1)|(カウント== 384から1)|(カウント== 512から1);

終了

endmodule
 
これは主にFSMの関連する1つの実装を提供する設計が正しく指定behaviro、正しいRTL記述を実現することができます!

 

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