無料で高レベルのシンセサイザー（のSystemC）

S

salma ali bakr

Guest
こんにちは、VHDLまたはVerilogまたはネットリストやハードウェア記述の任意の並べ替えにSystemCを変換して任意の空き高レベルのシンセサイザーはありますか？！ 、サルマ事前に感謝します：）
 
[/ URLの]のAdvares〜のSystemC / download_content.html [URL】http://www-ti.informatik.uni-tuebingen.de/を：こんにちはサルマは、このお試しください！
 
私が何をしたいの反対のことを実行するおかげで多くは...それは、SystemCとVHDLの変換！
 
CatapultC [のURL] http://www.mentor.com/products/esl/high_level_synthesis/catapult_synthesis/の[/URL]に参照してください
 
私たちは（FPGAのコミュニティ）のFPGA合成ツールを構築するために求めているなら我々は"configure"をするために使用されるbitfilesの仕様を知っている必要がない無料で高レベルの合成ツールが利用可能だと思うFPGAのあなたがで開発するアプリケーションとインスタンスのSystemC。本仕様書は、FPGAのメーカーから入手されていません...
 
こんにちは、人々は、私は指導者からのカタパルトを言及する合成のみのC / C + +のVHDLまたはVerilogまたはSystemCをする
 
カタパルトはとにかく自由ではない。私は、あなたが無料で得ることができるこのような何かがあるとは思えません。
 
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[引用=サルマアリバクル] [引用符は携帯、それが=]私は我々が（FPGAのコミュニティ）のFPGA合成ツールを構築するために求めているなら私達はbitfilesの仕様を知っている必要がない無料で高レベルの合成ツールが利用可能だと思う"構成"に使用されるFPGAのは、インスタンスSystemCに対しての開発アプリケーションと。本仕様書は引用]を...[/ FPGAメーカーから入手されていないデザインは、レベルをレジスタに転送されている場合、インスタンスのでは、ザイリンクスのSystem Generatorを...それから、非常に近いされているFPGAの構成モデル！システムの発電機では、こんにちはすべて、私はそれがあると思う（システムジェネレータ)...[/引用]こんにちはサルマで指定されたすべてのIOSと伊勢に、FPGA上にそれをダウンロードしてプロジェクトを取るし、HDLネットリストを生成することができます良いアイデアが、私は、異なるベンダーからのツールのことをたくさん見つけることが使用されており、それはいくつかのケースでそれらの間の非互換性を発生する可能性があります。これは、元の記述を中心と生成されたVHDLの間のSystemCベースのVHDLコンパイラで導入されたmisalignementを考慮いけない場合。誰もがこのテクニックは私たちがその効率を知らせようテストている場合してください。
 
空きコンバータは、この時点ではありません
 
ROCCC同社の無料のオープンソースは、c - > hdlのコンバータは、それを試して
 
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