プルダウン2002 0:08 09

F

Free_Will

Guest
誰でもアップとプルプルダウン
現象 を説明することはできます
か ?特に
我々のマイクロコントローラまたは論理素子を使用している場合。
私は
、 我々は彼らの状況を使用することを意味する
か を一例を挙げることができます

 
Free_Will書いた:

誰でもアップとプルプルダウン現象を説明することはできますか?
特に

我々のマイクロコントローラまたは論理素子を使用している場合。

私は、我々は彼らの状況を使用することを意味するかを一例を挙げることができます
 
すべての未使用のロジック入力は
、 適切なロジックレベルネクタイをする必要があります。

この目的のために私たちの抵抗を使用することができます。

プルアップ抵抗のVCCからの入力に接続してください。
プルダウン抵抗入力からGNDに接続。

Forexampleしている場合
、 ゲートが1つしかない場合入力します。
あなたが未使用の入力にプルアップ抵抗を使用する必要があります。
お客様のシステムdont働く場合はプルダウン抵抗を使用しています。ため
、 論理0レベル

、 出力を抑制する。

 
オープンコレクタ出力の場合には
、 二国間の低出力に切り替えることができますはICがある(それ
) とは
、 指定された量の電流シンクすることができます

Hi - Ž - >のようにそれがすべてで接続され
ていない が
、 それは
、 出力には効果があることを意味行為。場合は
、 ロジックハイ状態に興味があるのではなく
、 1つの端末は
、 ICの出力に接続し
、 他のVCCにプルアップ抵抗を追加する必要があります。

よろしく

 
がある場合に該当トライステートロジック(
水平
Lを Z )
は つまり
、 両方のバストランシーバのプルアップまたはプルダウンフローティング入力を防止するために
使われる が、プルアップされたのTTLのノイズマージンのために
、 推奨ソ¥リューション対応し
ています 回路
H の状態Lに比べて大きいです(
つまり 1つの多くの
" アクティブロー"の入力の理由の一つ

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乾杯

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ここには良い
と の説明
のリンクですプルアップを使用して/ pulldownsは
、 PICをマイコン。

http://www.piclist.com/techref/logic/xtrapins.htmニックC.

 
http://www-s.ti.com/sc/psheets/scba004c/scba004c.pdf
を見て
 
あなたが知っているいや
、 高速ロジックの上昇速度を低下。

この問題の別のポイント....

 
を引き出す技術である。このような方法で
のIC ベンダは
、 出力ドライバ(通常はBJTトランジスタ)を任意の負荷
を 。彼は良い負荷とのVCCしたいユーザーを選択します。

 
オー!すみませんが!

プルダウン をプルアップされると、同じですが
、 出力トランジスタがPNPトランジスタ( PMOS ) 。

 
やあ
場合
、 U
は 上または下の抵抗はピンを抜くことができるソ¥ースまたはシンクを使用しないように高電流
これになるの現象は
、 誘導ノイズのために不安定。
見る
詳細
は :

http://korea.maxim-ic.com/appnotes.cfm/appnote_number/551

敬具

 
をGoogleで検索できる
ため 、多く
の 情報
があります 。

 

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