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イムは、レジスタをシフト平行-シリアル質問するために使用指導をグラフィックに設計します。誰もがデザインこのために得たアイデアですか？
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最初のアイデアを投稿自分のしてください、私たちはあなたに沿ってすることができます導く。フィードをこのようにスプーンする必要がある習慣は我々が。
http://www.play-hookey.com/digital/shift-in_register.html
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[No message]
F
fpga_asic_designer
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それはハードすぎるかもしません。あなたは、Verilogをすることができます使用して、それをコードするだけ
常に@（posedge iclk）
始める
qは[5] <= qは[4];
qは[4] <= qは[3];
qは[3] <= qは[2];
qは[2] <= qは[1];
qは[1] <= qは[0];
qは[0]は<= idが。
1の場合（カーボンナノチューブ=='H5型）CNTの<='H0が、他のCNTの<= CNTの ;
終了
常に@（posedge iclk）
始める
[場合（カーボンナノチューブ=='H5型）odata <= qは[を午前5時。
他のodata <= odata;
終了
常に@（posedge iclk）
始める
qは[5] <= qは[4];
qは[4] <= qは[3];
qは[3] <= qは[2];
qは[2] <= qは[1];
qは[1] <= qは[0];
qは[0]は<= idが。
1の場合（カーボンナノチューブ=='H5型）CNTの<='H0が、他のCNTの<= CNTの ;
終了
常に@（posedge iclk）
始める
[場合（カーボンナノチューブ=='H5型）odata <= qは[を午前5時。
他のodata <= odata;
終了